Synopsys Compute Express Link (CXL) Controller IP实现了构建CXL设备、主机或交换机所需的端口逻辑,并可配置为支持设备和主机模式之间运行时可选的双模式应用程序。可配置和可扩展的IP支持CXL 3.0规范的所有关键特性,并完全向后兼容CXL 2.0、1.0和1.1规范。该IP还支持PCI Express 6.0、5.0、4.0和3.1规格,并可以通过内置的PIPE 6轻松连接到Synopsys 64GT/s PHY。x接口。CXL控制器支持Synopsys的MultiStream架构,提供多个应用程序接口,可跨各种链路宽度和有效负载实现最大吞吐量效率。高质量、可综合的IP在64GT/s x16配置中进行了最大吞吐量和最小延迟的优化,但可以配置为支持CXL端口分岔和降级模式,以及所有3种定义的CXL设备类型,以实现最大的应用灵活性。Synopsys CXL Controller IP快速轻松地集成到片上系统(SoC)设计中,具有用户友好的应用程序接口或行业标准AMBA接口,具有适用于广泛ASIC和FPGA技术的保守时序。
的
Synopsys CXL集成和数据加密(IDE)安全模块符合标准,并通过Synopsys Controller IP进行预验证,以帮助设计人员保护soc中的数据传输不受篡改和物理攻击。该安全模块满足了CXL.cache/的高带宽、最佳区域和低至零周期的时延要求。Mem协议在滑动模式。CXL控制器与IDE安全IP模块支持TEE设备接口安全协议(TDISP)。PCI-SIG发布的io协议。TDISP标准化框架定义了如何保护虚拟机主机和设备之间的互连,而不管数据中心位于何处或谁有权访问内部服务器。带IDE的Synopsys CXL控制器使设计人员能够在其超大规模soc中构建完整的TDISP支持,并减轻数据和系统攻击,解决安全I/O虚拟化的挑战。
Synopsys CXL控制器IP基于Synopsys PCI Express控制器IP,该控制器IP已通过多种硬件平台、物理接口和PCI Express验证套件的1800多种设计进行硅验证,从而降低风险并加快上市时间。作为PCI Express的行业标准,Synopsys提供了全面的批量生产IP解决方案,并已在广泛的应用中成功实现。
Synopsys CXL (Compute Express Link)控制器IP
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- 支持CXL 3.0、2.0、1.1和1.0规范中的所有关键特性和性能要求
- 支持PCI Express 6.0 (64GT/s)、5.0 (32 GT/s)、4.0 (16 GT/s)、3.1 (8 GT/s)和PIPE(32位)规格的所有所需功能
- CXL的应用程序接口选择。io包括Synopsys本机PCIe接口或可选的Arm®AMBA®4 AXI和AMBA 3 AXI接口支持
- CXL优化接口的选择。cache和CXL。mem - Synopsys Native CXL接口或Arm AMBA CXS接口
- 基于硅验证的512位PCIe 6.0控制器设计
- Synopsys IDE安全模块符合标准,可保护使用CXL 3.0和2.0接口的soc的数据传输
- CXL的TDISP支持。io用于单根I/O虚拟化(SR IOV)和通过IDE实现硬件安全
CXL 2.0高级控制器设备/主机/DM 512b |
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CXL 2.0高级控制器设备/主机/DM 512b带AMBA桥接 |
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CXL 2.0高级控制器设备/主机/DM 512b,支持AMBA桥接+ LTI和MSI-GIC接口 |
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CXL 2.0高级控制器设备/主机/DM 512b,支持AMBA桥接+ LTI和MSI-GIC接口 |
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